EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子）› 数字IC设计【ASIC|IC前端|FPGA】› 数字IC设计讨论(IC前端|FPGA|ASIC)

数字IC设计讨论(IC前端|FPGA|ASIC) 今日: 0|主题: 30951|排名: 32

版主: shiyinjita, guofu2010, acgoal, chinafpga, dlb05061131, neoitachi, tangyutao, yadog, everhappy, HADIST, chevroletss, arthur_wang_orz, wanghl_beijing

1 ... 35 36 37 383940 41 42 43 ... 885 / 885 页下一页

返回发新帖

新窗全部主题最新热门热帖精华更多 \| 显示置顶		作者	回复/查看	最后发表


[原创] FPGA时序约束分享04_output delay 约束(连载）	chop147 2022-7-27	11835	ic886 2024-6-8 22:35
[原创] XILINX FIFO写不进去的问题(实用分享)	chop147 2022-3-2	52513	ic886 2024-6-8 22:24
[原创] FPGA设计实用分享02 之 XILINX的可参数化FIFO	chop147 2022-3-9	62792	ic886 2024-6-8 22:19
[原创] Xilinx官方的DP例程的建立步骤	chop147 2024-6-8	11443	ic886 2024-6-8 21:21
[原创] PCIE项目案例合集	chop147 2024-6-8	01020	chop147 2024-6-8 15:21
[原创] edp和V-by-on接口设计	chop147 2024-6-8	0609	chop147 2024-6-8 15:18
[讨论] Sigma-delta ADC中的DNL和INL有没有必要去关注和评估？ ...2	艾克0928 2017-9-12	106942	Riching 2024-6-7 22:23
[讨论] vivado 模块被当成了blackbox	scutlee 2024-6-7	0416	scutlee 2024-6-7 11:26
[求助] 求移知上的AMBA进阶之AXI总线实战，可分摊学费	ysyandysm 2024-6-6	0678	ysyandysm 2024-6-6 17:11
[讨论] Altera HLS学习路径	海神波塞冬 2024-6-6	0603	海神波塞冬 2024-6-6 16:30
[讨论] 关于卡尔曼滤波的FPGA实现的想法	李宝绪 2014-1-20	11925	blazar 2024-6-6 15:33
[求助] spygalss cdc 数据用作时钟的报错怎么解决	kassadin 2024-6-4	6749	kassadin 2024-6-6 15:17
[求助] 有关nic400自带的dct综合脚本的问题	吕归尘 2024-6-4	6968	吕归尘 2024-6-6 10:16
[原创] 个人写的DDR3的工作原理，欢迎大家拍砖！精华1 ...2 3 4 5 6..47	dzplay 2015-5-23	463143606	542002990 2024-6-6 07:52
[资料] VCS使用手册	ICer_hao 2024-6-5	2780	icroad 2024-6-6 00:50
[资料] PCIE资料	ICer_hao 2024-6-5	1707	ic886 2024-6-5 21:53
[原创] Spyglass CDC检查脚本模板 ...2	ICer_hao 2024-3-6	132010	ic886 2024-6-5 21:42
[讨论] 用vivado综合完工程，文件路径就变了，那我怎么刷新文件呢？？	scutlee 2024-6-5	0460	scutlee 2024-6-5 18:29
[求助] Verilog中信号保持要不要明确写出来	时间在走人在变 2024-6-5	1607	zhaozhety 2024-6-5 18:21
[求助] vivado可以输出xdl文件吗？	Rita_Jia 2024-6-5	1783	西西在冰城 2024-6-5 15:35
[讨论] ICG怎么样插入？？	scutlee 2024-5-21	81041	kl_upc 2024-6-5 15:22
[讨论] 8b/10b编码与GTX的恩怨情仇精华3 ...2	qiurijian 2017-10-10	1813475	kl_upc 2024-6-5 15:19
[求助] 求问designware的div_lp_pipe IP是用什么算法实现的？	leolew 2024-6-5	0494	leolew 2024-6-5 09:58
[求助] spyglass cdc 报跨时钟域同步寄存器列表	watertree 2021-12-29	31873	easonjake333 2024-6-5 08:46
[原创] 求一篇论文	takeshineshiro 2024-6-4	2604	joshuacp 2024-6-5 08:04
优秀设计的十大戒律 ...2 3 4 5 6..7	coland 2008-5-22	6816445	clslhy 2024-6-4 18:09
[资料] Digital Audio Signal Processing ...2 3	shubh_ic 2013-3-28	2710787	clslhy 2024-6-4 17:50
[求助] 移位寄存器产生序列疑问	时间在走人在变 2024-6-4	1730	sogaside 2024-6-4 15:56
[求助] 问一个很基础的dc综合的时钟周期的问题	鹅鹅鹅丶 2024-6-4	3781	hxy2018 2024-6-4 13:28
[求助] verdi负功耗问题	chaotao_lin 2024-5-30	2573	chaotao_lin 2024-6-4 11:34
[求助] 请问有没有对TDF8532HH/N3芯片比较了解的大佬	Mrikato 2024-6-4	0428	Mrikato 2024-6-4 10:45
[讨论] 问一个问题，时钟分频的div_num不需要同步吗？？	scutlee 2024-6-4	0326	scutlee 2024-6-4 09:43
[求助] 关于ams 仿真器仿真速度过慢的问题	Amyha 2021-4-12	95603	qqlpp 2024-6-3 20:45
[资料] 【分享电子书】新一代通用视频编码H.266VVC：原理、标准与实现 ...2	zywttt 2024-1-26	152116	ic886 2024-6-3 19:36
[原创] Xilinx高端FPGA PCIE3.0IP分析文档 ...2 3	TimChern 2018-8-8	2911535	Electron_tube 2024-6-3 19:16

1 ... 35 36 37 383940 41 42 43 ... 885 / 885 页下一页

返回发新帖

账号		自动登录	找回密码
密码			注册

数字IC设计讨论(IC前端|FPGA|ASIC) 今日: 0|主题: 30951|排名: 32

快速发帖

浏览过的版块