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[求助] RTL中能写延时”#“吗?

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发表于 2024-7-23 10:22:24 | 显示全部楼层 |阅读模式

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如下代码,下面的代码前仿真能够实现a到b的延时。 我的疑问是,这种写法是合规的吗?是否可综合?综合出来的电路和前端仿真有差别吗?


`timescale 1ns/1ps


assign #2 a = b;


发表于 2024-7-23 11:06:59 | 显示全部楼层
不可综合,只能用于仿真
发表于 2024-7-23 11:18:09 | 显示全部楼层
楼上是对的,楼主这样是无法综合出实际电路的
发表于 2024-7-26 15:34:16 | 显示全部楼层
楼上是对的。
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