在线咨询 切换到宽版
eetop公众号 创芯大讲堂 创芯人才网

 找回密码
 注册

手机号码,快捷登录

手机号码,快捷登录

搜帖子
作者 回复/查看 最后发表
[求助] 请问分别基于RTL和网表仿真时,tb的区别 JChenne 2022-7-24 21981 gaurson 2022-7-25 18:07
[求助] 随路时钟? 追乐人66 2022-7-23 33303 Love24 2022-7-25 11:19
[求助] 编写eeprom读写的一个小问题  ...2 余晖尽落 2015-12-3 106023 林志杰 2022-7-25 10:36
[原创] 标准单元驱动能力 Leon.sl 2022-7-24 42258 Leon.sl 2022-7-25 09:44
[求助] tcl脚本里,如何实现 set a[split $b [ ], 即以[ 分割$b, 尝试了转义,但发现没用 超超0508 2022-7-21 72013 超超0508 2022-7-25 09:38
[求助] Looking for VERILOG-XL 2.0.1 license for sun4 platform. ashish 2022-7-25 02047 ashish 2022-7-25 02:12
[求助] verilog代码design_vision导入失败 - [已解决] 顾北 2022-7-23 41844 ashish 2022-7-25 01:55
[求助] assign赋值reg 雨中有座沧浪亭 2022-7-23 32109 雨中有座沧浪亭 2022-7-24 22:46
[资料] c++资料 lancerone 2022-7-24 02036 lancerone 2022-7-24 22:34
[资料] 数字IC设计开发画时序图的好工具  ...2 艾艾小阳 2022-6-4 124186 leb925 2022-7-23 22:55
[求助] 怎么学习matlab代码来实现pipeline adc的行为建模 Aeternum 2022-7-22 01639 Aeternum 2022-7-22 20:22
[求助] 求助!!关于DC中时序约束SDC的疑问 三岁就十分拽 2022-7-11 62208 三岁就十分拽 2022-7-22 16:52
[资料] 明德扬基于XILINX K7核心板325T/410T chop147 2022-7-22 02027 chop147 2022-7-22 10:46
[资料] fifo资料 lancerone 2022-7-6 62372 lans0625 2022-7-22 09:07
[求助] 请教如何在modelsim里如何进行例化模块内的inout信号的仿真? - [已解决] 磁轨炮 2022-7-7 72080 jfeta 2022-7-22 06:12
[资料] FPGA高级时序约束  ...23 wangheping123 2019-2-9 249603 jfeta 2022-7-22 05:51
[求助] 是否有工具支持将可综合systemverilog直接转为Verilog? - [悬赏 100 信元资产] hellcer 2022-7-21 52559 轩辕志瑜 2022-7-22 01:54
[讨论] 问问大家否怎么使用time designer的?感觉用timegen很方便 cgssuccess 2013-9-21 912268 Topiler 2022-7-21 19:39
[求助] 请问ISE综合以后,看资源占用,主要是查看综合报告哪一项? ttxs2009 2014-8-28 419127 fengbohan1 2022-7-21 15:57
[讨论] 串并转换写成移位寄存器还是寻址寄存器比较好?  ...2 cqugjw 2013-6-28 118001 fengbohan1 2022-7-21 15:03
[求助] 请教一个FPGA读写DDR2的问题 djqlyy2922 2022-7-21 11520 jinj198908 2022-7-21 13:09
[原创] cdc 新人帖 kevin.yang0922 2021-6-9 32419 jfeta 2022-7-21 06:19
请教一个跨时钟域的后仿问题  ...23456..8 vlog 2006-11-14 7432476 qq787766401 2022-7-20 11:52
[求助] soc 小光头请多指教 2022-7-19 01921 小光头请多指教 2022-7-19 20:36
[求助] 求助位宽计算 新人帖 ztseng 2022-7-12 42315 ztseng 2022-7-19 11:37
[求助] vivado 例化dds ip核时 dds输出是定值 追乐人66 2022-7-18 92145 追乐人66 2022-7-19 11:30
[讨论] 对clock设置set_clock_transition与时序分析 wangxuede220 2011-6-14 618737 背对背拥抱 2022-7-18 14:30
[求助] 求大佬 追乐人66 2022-7-16 11883 fengbohan1 2022-7-18 12:08
[求助] MIG核控制ddr3操作 追乐人66 2022-7-17 21862 fengbohan1 2022-7-18 12:05
[原创] ADS2019 linux hqubyf 2019-2-25 33728 Yonion 2022-7-18 10:06
[求助] 求SNPS最新的tools zhushining 2022-7-15 11555 designstart 2022-7-16 11:13
[求助] 求助:DW_apb_XXX 只能产生加密了的文件,无法生成源文件 - [悬赏 200 信元资产] chencsw 2014-3-17 44555 designstart 2022-7-16 11:12
[求助] 问大佬 vavido BANKBONE 追乐人66 2022-7-16 01370 追乐人66 2022-7-16 10:36
[求助] 从事处理器/数字IC/体系结构更看重科研经历还是工程经历和能力呢 新人帖 XinChen_ 2022-7-16 01531 XinChen_ 2022-7-16 10:27
[原创] 使用vcs编译出现错误 - [悬赏 30 信元资产] lwf 2022-2-25 41979 dihero 2022-7-15 17:36
下一页 »

快速发帖

还可输入 120 个字符
您需要登录后才可以发帖 登录 | 注册

本版积分规则

手机版| 小黑屋| 关于我们| 联系我们| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2025-6-12 23:16 , Processed in 0.128667 second(s), 5 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
返回顶部 返回版块