直接产生verilog的testbench的python脚本

jackhb007 · 发表于 2021-7-29 14:00:09

look look

lglglg · 发表于 2021-8-12 12:38:55

非常感谢

joshuaxue · 发表于 2021-8-17 14:13:27

thanks a lot

sysclock · 发表于 2021-9-11 16:24:46

vTbgenerator.py ModuleFileName.v | tee tb.v

njyxq · 发表于 2021-12-16 16:37:14

C:\Users\stars>python3 D:\python\eetop.cn_vTbgenerator\vTbgenerator.py jtag_seq_tb.v Traceback (most recent call last): File "D:\python\eetop.cn_vTbgenerator\vTbgenerator.py", line 213, in <module> writeTestBench(sys.argv[1]) File "D:\python\eetop.cn_vTbgenerator\vTbgenerator.py", line 144, in writeTestBench inFile = open(input_file) FileNotFoundError: [Errno 2] No such file or directory: 'jtag_seq_tb.v'

njyxq · 发表于 2021-12-16 16:38:01

为什么报错了呢

hanxiong99 · 发表于 2021-12-23 09:57:14

thanks!!!!

lee_lee123 · 发表于 2021-12-23 19:09:49

先收藏了。。。

徐常杭 · 发表于 2022-5-20 08:26:44

谢谢楼主的好资料

WWJun · 发表于 2022-6-21 18:30:51

好东西，强强

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