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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › AHB总线下的slave ram的verilog代码

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楼主: love-asic

AHB总线下的slave ram的verilog代码

发表于 2013-8-28 13:55:30 | 显示全部楼层

谢谢楼主，学习一下！

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发表于 2013-9-23 18:19:48 | 显示全部楼层

正在找這個東西。謝謝分享啦。

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发表于 2013-11-7 10:53:41 | 显示全部楼层

楼主辛苦了！

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发表于 2013-11-26 14:24:48 | 显示全部楼层

楼主辛苦了！

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发表于 2013-12-3 15:08:02 | 显示全部楼层

正好需要楼主的这个东西，谢谢了

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发表于 2014-2-10 15:04:17 | 显示全部楼层

回复 1# love-asic

多少钱啊,怎么我没法下呢

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发表于 2014-4-26 19:29:05 | 显示全部楼层

hen bu cuo a ,hehe

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发表于 2014-4-27 02:31:00 | 显示全部楼层

不错谢谢分享

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发表于 2014-4-27 02:31:44 | 显示全部楼层

不错谢谢分享

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发表于 2014-4-27 02:32:22 | 显示全部楼层

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