在线咨询 切换到宽版
eetop公众号 创芯大讲堂 创芯人才网

 找回密码
 注册

手机号码,快捷登录

手机号码,快捷登录

搜帖子
楼主: 空白MAX

[资料] Digital Design With an Introduction to the Verilog HDL, VHDL, and SystemVerilog

[复制链接]
发表于 2022-4-17 19:22:24 | 显示全部楼层
Digital Design With an Introduction
发表于 2022-4-17 20:47:30 | 显示全部楼层
谢谢分享
发表于 2022-4-17 22:08:44 | 显示全部楼层
感谢
发表于 2022-4-17 23:00:18 | 显示全部楼层
学习下
发表于 2022-4-17 23:38:29 | 显示全部楼层
感谢
发表于 2022-4-18 00:01:59 | 显示全部楼层
求见,学学学习
发表于 2022-7-3 14:52:30 | 显示全部楼层
本帖最后由 goodtest 于 2022-11-5 01:13 编辑

谢谢分享
发表于 2022-7-3 22:14:38 | 显示全部楼层
Thanks
发表于 2022-7-5 21:27:56 | 显示全部楼层
感谢分享
发表于 2022-7-21 19:51:38 | 显示全部楼层
good
您需要登录后才可以回帖 登录 | 注册

本版积分规则

手机版| 小黑屋| 关于我们| 联系我们| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2025-6-9 09:30 , Processed in 0.126829 second(s), 3 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
快速回复 返回顶部 返回列表