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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › Verilog数字系统设计教程-夏宇闻-第三版

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楼主: vividdream

[资料] Verilog数字系统设计教程-夏宇闻-第三版

楼主| 发表于 2020-9-5 20:05:11 | 显示全部楼层

andy_zhou 发表于 2020-9-5 09:37
影印版感觉不是很清晰啊，楼主有原版的吗？

没有。

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发表于 2020-9-24 21:17:35 | 显示全部楼层

thanks for your sharing

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发表于 2020-9-24 21:55:43 | 显示全部楼层

谢谢分享

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发表于 2020-10-9 11:43:49 | 显示全部楼层

Thanks!!!!

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发表于 2020-10-9 12:39:07 | 显示全部楼层

Thanks!!!

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发表于 2020-10-16 20:31:33 | 显示全部楼层

谢谢分享。。。。。

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发表于 2020-10-18 09:01:37 | 显示全部楼层

classic book.

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发表于 2020-11-10 08:57:04 | 显示全部楼层

谢谢大佬

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发表于 2020-11-28 12:31:47 | 显示全部楼层

谢谢分享

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发表于 2020-11-30 21:12:30 | 显示全部楼层

thanks very much

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