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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 时序设计与约束资料汇总

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楼主: ray21880

[资料] 时序设计与约束资料汇总

发表于 2018-11-20 20:00:46 | 显示全部楼层

谢谢楼主！

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发表于 2019-4-2 23:11:53 | 显示全部楼层

謝大大分享，來學習一下時序

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发表于 2019-4-6 00:07:42 | 显示全部楼层

Thanks a lt

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发表于 2019-4-7 06:33:31 | 显示全部楼层

thanks a lot

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发表于 2019-5-14 17:41:57 | 显示全部楼层

看看学习学习

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发表于 2019-5-25 18:59:27 | 显示全部楼层

下载学习一个

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发表于 2019-5-25 22:18:28 | 显示全部楼层

谢谢分享

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发表于 2019-5-26 09:50:48 | 显示全部楼层

谢谢分享

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发表于 2019-6-1 18:51:45 | 显示全部楼层

着资料到底好不好哟

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发表于 2019-6-1 18:52:28 | 显示全部楼层

有必要卖那么贵吗

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