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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 时序设计与约束资料汇总

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楼主: ray21880

[资料] 时序设计与约束资料汇总

发表于 2018-9-29 08:57:13 | 显示全部楼层

Thanks!

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发表于 2018-9-29 23:15:49 | 显示全部楼层

good.thanks

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发表于 2018-9-30 11:45:20 | 显示全部楼层

谢谢楼主分享

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发表于 2018-9-30 11:50:36 | 显示全部楼层

学习一下

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发表于 2018-9-30 11:56:21 | 显示全部楼层

谢谢分享，资料很不错

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发表于 2018-9-30 12:00:55 | 显示全部楼层

下来看看。。

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发表于 2018-9-30 12:47:11 | 显示全部楼层

好东西，感谢分享

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发表于 2018-9-30 13:05:40 | 显示全部楼层

很好的资料，感谢楼主分享

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发表于 2018-9-30 13:06:46 | 显示全部楼层

很有参考意义,谢谢

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发表于 2018-9-30 14:36:12 | 显示全部楼层

很好的资料

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