你是用VHDL还是用Verilog HDL？

xiaoxiaohe · 发表于 2023-2-21 20:53:36

主流啊

igigigigig · 发表于 2023-6-7 00:06:56

verilog + systemverilog

dennisi123 · 发表于 2023-6-12 19:22:53

VHDL yyds

潇洒的蛋壳Chris · 发表于 2023-7-5 19:55:12

verilog+system_verilog，这些语言应该会向更抽象的上层发展。

rocsman · 发表于 2023-8-4 23:39:10

目前开始用VHDL了

a2532927 · 发表于 2023-11-5 21:01:09

verilog简单一些

flyskyseu · 发表于 2023-11-30 11:47:20

现在verilog和systemverilog是主流吧

Ahungry_man · 发表于 2024-1-10 15:42:03

verilog

liguchu · 发表于 2024-1-15 10:19:29

Verilog是主流吧，国内主要用Verilog

binnq · 发表于 2024-1-22 13:57:06

verilog太像C,又不是C，太容易混淆，更喜欢VHDL

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