你是用VHDL还是用Verilog HDL？

tinybluebottle · 发表于 2021-2-21 10:30:37

verilog

超高校级的海绵 · 发表于 2021-4-2 11:15:22

现在工作中基本就是verilog了，大学里用vhdl会比较多

soldierwuhan · 发表于 2021-4-29 01:09:18

谢谢分享

xiezg · 发表于 2021-5-19 14:52:01

目前只会verilog

leolew · 发表于 2021-6-17 15:15:51

verilog明显多啊

yyk123 · 发表于 2021-6-30 17:40:14

我用SystemVerilog ， verilog 被合并成IEEE 1800.2 SystemVerilog了

aiqiongqiong · 发表于 2021-7-8 08:15:21

主要用verilog，因为最开始学的verilog，后面也学了VHDL。我觉得VHDL比verilog更加严谨，需要注意的更多。

xxxiexieu · 发表于 2021-7-15 10:17:10

现阶段还是verilog为主吧~

JerryRaphael · 发表于 2021-7-22 09:04:14

Verilog

你看了你 · 发表于 2021-7-27 13:50:58

VHDL现在越来越少人用了

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