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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 详细讲解verilog的case/casex/casez(英文pdf)
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楼主: jerrycao

[资料] 详细讲解verilog的case/casex/casez(英文pdf)

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发表于 2014-1-14 09:41:09 | 显示全部楼层
多谢多谢
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发表于 2014-8-18 09:50:04 | 显示全部楼层
感謝~獲益良多~
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发表于 2014-11-23 22:18:22 | 显示全部楼层
下来看看
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发表于 2014-11-26 17:52:35 | 显示全部楼层
很好的文章，谢谢
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发表于 2015-12-1 11:32:53 | 显示全部楼层
十分感謝!
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raojp
发表于 2016-5-17 15:53:09 | 显示全部楼层
谢谢分享！
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发表于 2016-5-19 18:39:27 | 显示全部楼层
谢谢 好东西
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发表于 2016-6-3 15:30:23 | 显示全部楼层
好东西，多谢
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发表于 2016-7-8 18:38:32 | 显示全部楼层
thank you!
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