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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 详细讲解verilog的case/casex/casez(英文pdf)
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楼主: jerrycao

[资料] 详细讲解verilog的case/casex/casez(英文pdf)

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jpw22
发表于 2011-3-18 13:32:46 | 显示全部楼层
谢谢谢谢！
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发表于 2011-4-20 11:22:26 | 显示全部楼层
好啊的啊
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chanon
发表于 2011-4-27 12:12:06 | 显示全部楼层
谢谢！！
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xel111
发表于 2011-4-27 17:41:51 | 显示全部楼层
很棒的文件，good...
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ic405
发表于 2011-6-15 11:17:15 | 显示全部楼层
谢谢分享~~~~
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lhrace
发表于 2011-8-5 16:08:54 | 显示全部楼层
还算是可以的，
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joswa
发表于 2011-8-5 18:15:03 | 显示全部楼层
That's really great!
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发表于 2011-8-16 19:47:14 | 显示全部楼层
谢谢看看
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发表于 2011-8-22 16:44:21 | 显示全部楼层
看看学习下
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jyaray
发表于 2011-12-8 14:42:46 | 显示全部楼层
hhhhhhhhhhhhhhhhhhhhhhhhhhhhhhhhh
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