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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › USB2.0的IP核（详细verilog源码和文档）

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楼主: whil_rin

USB2.0的IP核（详细verilog源码和文档）

发表于 2010-5-28 20:47:20 | 显示全部楼层

先看看

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发表于 2010-5-28 23:00:50 | 显示全部楼层

thanks

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发表于 2010-5-31 17:14:47 | 显示全部楼层

Thanks for sharing!

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发表于 2010-6-1 10:32:55 | 显示全部楼层

Thanks for sharing

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发表于 2010-6-1 12:31:43 | 显示全部楼层

SPDIF 数字传输接口概念解析

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发表于 2010-6-10 15:05:46 | 显示全部楼层

学习一下！！！！！11

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发表于 2010-6-10 21:28:48 | 显示全部楼层

强悍啊门槛

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发表于 2010-6-11 11:04:57 | 显示全部楼层

谢谢.

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发表于 2010-7-11 12:41:11 | 显示全部楼层

thanks!

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发表于 2010-7-11 17:25:08 | 显示全部楼层

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