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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › IC验证 › IC验证资料 › Verification Methodology Manual for SystemVerilog.

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楼主: wuhuhusong

Verification Methodology Manual for SystemVerilog.

发表于 2012-5-14 23:07:15 | 显示全部楼层

Thanks very much

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发表于 2012-5-14 23:07:49 | 显示全部楼层

thanks very much. which is the one I want

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发表于 2012-6-7 22:23:45 | 显示全部楼层

感谢楼主分享。。好书啊

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发表于 2012-8-18 16:06:19 | 显示全部楼层

谢谢楼主分享！

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发表于 2012-9-18 19:18:05 | 显示全部楼层

谢谢lz，果断下载

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发表于 2012-9-18 19:19:06 | 显示全部楼层

晕，怎么有两次回复，难道我下了两次么。。。

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发表于 2012-9-18 22:23:59 | 显示全部楼层

回复 7# liuqing

谢谢版主！

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发表于 2012-9-18 23:34:54 | 显示全部楼层

VMM手册么？

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发表于 2013-1-29 06:05:20 | 显示全部楼层

thans very much

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发表于 2013-2-23 20:16:15 | 显示全部楼层

good verygood

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