FPGA无法从PROM中进行configure

一声叹息 · 发表于 2003-10-27 18:11:29

sorry,是用init_b的上升沿触发。
另外，可以看一下program拉低时，init_b的变化。

qinzhijie842 · 发表于 2009-9-9 14:01:41

遇到同样的问题

zeusyi · 发表于 2009-10-13 09:28:10

ls解决了么？
我也出现类似问题
断开cclk后，cclk能正常翻转
一旦接上prom的时钟引脚，就很快的被上拉到高电平

大伙儿有什么解决方法或者思路么？

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