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Yong_W 发表于 2025-6-26 19:05 好像是得选这个定义Verilog文件位置,或者选上面一个
waves_0011 发表于 2025-6-26 22:06 library list填上你不识别的库,再点一下recompute。
cotonier 发表于 2025-6-27 08:17 不用管它,这些子模块你只要编译好了就行,在ams仿真时候需要加入那个预编译库,worklib之类的。 ...
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