关于ram效率与大数据需求情况的求解

关东煮游泳 · 发表于 2024-6-25 11:21:11

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楼主最近在学着做一个卷积加速单元，若是要达到性能要求，流水线下一拍得从ram中搬出81个16bit数，这意味着ram需要大量的IO接口，显然这是不合理的，所以想请问一下大伙儿一般ram设计的接口数大概是什么范围，以及碰到这种大数据需求量的情况有没有什么好的解决办法，谢谢！

harry_hust · 发表于 2024-6-25 13:44:01

是每一拍都得搬81个数？还是只有这下一拍才需要搬这81个数？
如果是每一拍都需要，需要优化/合并一下 ram；
如果是只有下一拍才需要搬，那就是流水设计不合理，重新设计一下计算流水吧

关东煮游泳 · 发表于 2024-6-26 16:57:22

harry_hust 发表于 2024-6-25 13:44
是每一拍都得搬81个数？还是只有这下一拍才需要搬这81个数？
如果是每一拍都需要，需要优化/合并一下 ram； ...

谢谢回复，话说每拍的最大搬运应该被数据总线位宽写死了吧，优化/合并具体能指哪些方面呢

harry_hust · 发表于 2024-6-26 19:17:15

关东煮游泳发表于 2024-6-26 16:57
谢谢回复，话说每拍的最大搬运应该被数据总线位宽写死了吧，优化/合并具体能指哪些方面呢
...

如果是通过总线搬数据，那速率是有上限的。但既然要做加速单元，存储资源应该在加速过程中放给加速逻辑直接访问，或者多个 cut 并行访问。

关东煮游泳 · 发表于 2024-6-27 11:14:01

harry_hust 发表于 2024-6-26 19:17
如果是通过总线搬数据，那速率是有上限的。但既然要做加速单元，存储资源应该在加速过程中放给加速逻辑直 ...

好的，感谢大佬

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