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[讨论] 关于DDR controller的频率

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发表于 2023-8-2 12:45:40 | 显示全部楼层 |阅读模式

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假如 DRAM 支持DDR5 5600Mbps,那么在frequency ratio mode 1:4的情况下,DDR controller 和DDR PHY 频率是不是应该等于 DATA ratio/8 = 700MHz??
发表于 2023-8-2 13:46:25 | 显示全部楼层
嗯,没错
 楼主| 发表于 2023-8-2 13:59:41 | 显示全部楼层


DDR controller 和DDR PHY的clock同步的吗??data rate 指的是IO的等效频率?不需要考虑位宽的吗?假如DQ 8bit ,不是应该5600Mbps/8吗
发表于 2023-8-2 17:40:36 | 显示全部楼层
这个只是给phy的参考时钟,phy里面会用pll产生一个高速时钟
 楼主| 发表于 2023-8-2 20:14:14 | 显示全部楼层


   
sean.ni 发表于 2023-8-2 17:40
这个只是给phy的参考时钟,phy里面会用pll产生一个高速时钟


经过PLL产生的高速时钟大概就=dfi clock*4=data rate/2
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