电路中各元件失配对输出影响的贡献比仿真（bandgap）

Aladddin · 发表于 2023-7-31 16:36:06

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求助大佬！

对于一个BGR而言，如何仿真电路中的失配（比如电流镜、电阻、运放的Vos）对输出端影响的贡献占比？

就跟噪声的仿真占比一样。 = =

Aladddin · 发表于 2023-7-31 16:36:53

顶一下顶一下

JustdoitAbel · 发表于 2023-7-31 16:47:07

手动拉偏一下看效果；或者直接MC，然后统计各个参数偏差对输出的影响

LoktikVJ · 发表于 2023-7-31 17:51:02

Cadence virtuoso ADE Explorer has "Mismatch Contribution" option in menu(icon of two transistors with magnifying glass) to show effect from each component.

david_reg · 发表于 2023-8-1 22:56:31

如果只仿真DC 电压输出的话，可以试试 dcmatch分析，输出会打印各个匹配器件的贡献。

Aladddin · 发表于 2023-8-29 10:23:11

LoktikVJ 发表于 2023-7-31 17:51
Cadence virtuoso ADE Explorer has "Mismatch Contribution" option in menu(icon of two transistors wit ...

thanks！

spare01 · 发表于 2024-4-24 16:02:40

david_reg 发表于 2023-8-1 22:56
如果只仿真DC 电压输出的话，可以试试 dcmatch分析，输出会打印各个匹配器件的贡献。 ...

请问dcmatch的viaration=0怎么回事？

david_reg · 发表于 2024-4-24 19:43:23

spare01 发表于 2024-4-24 16:02
请问dcmatch的viaration=0怎么回事？

如果分析结果的variation=0有两个可能原因:

1. 模型中没有mismatch的统计参数; 建议检查一下模型库或section选择是否包含了monte-carlo分析所需要的部分; dcmatch分析与monte-carlo分析需要相同的模型库;
2. 输出结果对mismatch不敏感.

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