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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog/RF IC 设计 › Analog/RF IC 资料共享 › Verilog-A Language Reference Product Version 18.1

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查看: 3340|回复: 18

[资料] Verilog-A Language Reference Product Version 18.1

发表于 2023-6-23 09:55:27 | 显示全部楼层 |阅读模式

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Cadence® Verilog®-A Language Reference

Product Version 18.1
August 2018

3.31 MB, 下载次数: 142 , 下载积分: 资产 -2 信元, 下载支出 2 信元

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发表于 2023-6-23 14:17:59 | 显示全部楼层

thanks

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发表于 2023-6-23 19:36:55 | 显示全部楼层

thanks

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发表于 2023-6-24 09:57:35 | 显示全部楼层

多谢分享。。

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发表于 2023-6-24 23:03:33 | 显示全部楼层

多谢分享

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发表于 2023-6-26 14:44:06 | 显示全部楼层

Thanks.

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发表于 2023-6-26 20:35:55 | 显示全部楼层

3q for sharing !!!

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发表于 2023-6-27 14:02:21 | 显示全部楼层

thanks!

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发表于 2023-6-27 15:47:54 | 显示全部楼层

谢谢

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发表于 2023-9-29 22:25:06 | 显示全部楼层

thanks a lot!

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