AMS仿真报错Could not determine discipline for this expression

cheney84 · 发表于 2022-11-20 22:40:41

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本帖最后由 cheney84 于 2022-11-20 22:42 编辑

verilog写一个简单的计数器，输入端口接了模拟信号，全部都报这个错，in是其中一个输入端，求大佬解答.          Discipline resolution Pass...
            in,
               |
ncelab: *E,CUVDNF (.../verilog.v,5|16): Could not determine discipline for this expression .

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[求助] AMS仿真报错Could not determine discipline for this expression

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