参数化的异步FIFO如果用格雷码产生满信号，那么深度为2和1 的时候怎么设计

zzbala · 发表于 2022-8-16 14:19:30

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qiuzhu

糊粘丶 · 发表于 2022-8-16 15:28:52

深度为2的时候，需要什么特殊设计吗？不需要吧，还是一样的设计逻辑。
深度为1时，这玩意是个FIFO？不就是个buffer吗。

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