在线咨询 切换到宽版
eetop公众号 创芯大讲堂 创芯人才网

 找回密码
 注册

手机号码,快捷登录

手机号码,快捷登录

搜帖子
查看: 1857|回复: 4

[求助] 层次化设计,在place_opt前extract_rc一直报错,是什么原因?

[复制链接]
发表于 2022-7-7 10:40:08 | 显示全部楼层 |阅读模式

马上注册,结交更多好友,享用更多功能,让你轻松玩转社区。

您需要 登录 才可以下载或查看,没有账号?注册

×
用层次化设计做完子模块后,把它调回去top,然后做place_opt,但是在extra_rc一直报错,然后我用check_mv_design检查,报错是下面这个,但是我已经把库都导进去了,还是出现了这个报错 image.png
check_tlu_plus_files 没出现error

image.png

 楼主| 发表于 2022-7-7 10:41:05 | 显示全部楼层
这个报错是不是跟PVT有关?
发表于 2022-7-7 11:01:39 | 显示全部楼层
icc吧? mv check的report里pll的电压和mcmm不一致,改下lib里的voltage,重新出个db试试,之前也遇到过这种问题
 楼主| 发表于 2022-7-8 21:12:09 | 显示全部楼层


   
allen_tang 发表于 2022-7-7 11:01
icc吧? mv check的report里pll的电压和mcmm不一致,改下lib里的voltage,重新出个db试试,之前也遇到过这种 ...


请问一下是怎么看出是pll的电压和mcmm不一致的,小白没看懂,感谢
 楼主| 发表于 2022-7-18 21:48:32 | 显示全部楼层
已解决,是因为SRAM和其他IO没有单独设置PVT导致不一致
您需要登录后才可以回帖 登录 | 注册

本版积分规则

手机版| 小黑屋| 关于我们| 联系我们| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2025-5-29 00:55 , Processed in 0.111871 second(s), 5 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
快速回复 返回顶部 返回列表