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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › verilog建模实例

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楼主: ycsen

verilog建模实例

发表于 2009-10-12 23:36:04 | 显示全部楼层

goodssssssssssss

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发表于 2009-10-13 12:14:42 | 显示全部楼层

谢谢。。。。。。。。。。

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发表于 2009-10-13 16:07:19 | 显示全部楼层

谢谢楼主

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发表于 2009-10-13 16:14:51 | 显示全部楼层

??????????附件

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发表于 2009-10-26 10:32:25 | 显示全部楼层

很好的东东谢谢楼主！！！！

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发表于 2009-11-12 09:04:09 | 显示全部楼层

看看了

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发表于 2009-11-18 22:53:20 | 显示全部楼层

thanks~~

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发表于 2013-6-18 12:27:10 | 显示全部楼层

感谢楼主了~

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发表于 2013-6-18 14:15:33 | 显示全部楼层

不错的东西啊

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发表于 2013-8-9 22:52:41 | 显示全部楼层

走个流程。

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