Verilog HDL 高级数字设计(英文版)(PDF格式)

zhuweifang · 发表于 2008-3-25 16:10:33

太请了我喜欢

zhuweifang · 发表于 2008-3-25 16:11:32

太请了我喜欢

zhuweifang · 发表于 2008-3-25 16:12:59

太请了我喜欢

zhuweifang · 发表于 2008-3-25 16:32:20

abbr__Synthesizing,_and_Simulating__ASICs_and_FPGAs__using_VHDL_or_Verilog.part02.rar

zhuweifang · 发表于 2008-3-25 16:42:55

3abbr__Synthesizing,_and_Simulating__ASICs_and_FPGAs__using_VHDL_or_Verilog.part02.rar

yel27 · 发表于 2008-3-26 10:25:53

yao le

yel27 · 发表于 2008-3-26 10:34:06

money~~

yel27 · 发表于 2008-3-26 10:37:46

挣钱不容易啊

yel27 · 发表于 2008-3-26 10:43:31

zhexia qiong le

6510724 · 发表于 2008-3-26 18:59:13

:lol :lol :lol :lol :lol

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hehehehhehhe