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楼主: okfunny

[调查] 打算这个skill教程,先立个flag

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发表于 2022-4-2 16:53:46 | 显示全部楼层
相当不错,赞
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发表于 2022-4-21 14:55:42 | 显示全部楼层

谢谢大佬 终于等到你的教程了
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发表于 2022-7-4 15:36:40 | 显示全部楼层
THANKS
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发表于 2022-7-5 08:30:49 | 显示全部楼层

先收藏为敬
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发表于 2022-7-13 21:47:56 | 显示全部楼层
谢谢大神的教程
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发表于 2022-7-31 21:43:03 | 显示全部楼层
学习
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发表于 2022-8-1 08:50:13 | 显示全部楼层
GOOD IDEA
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发表于 2022-8-1 10:24:03 | 显示全部楼层
期待!
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发表于 2022-9-21 20:43:57 | 显示全部楼层
楼主很强,我有一个想法,想把常用的基本logic gate做成Pcell,大概效果是,在schematic里面Q logic gate可以设置里面的尺寸(不需要descend进去修改),然后生成版图的时候,可以做成pcell,支持出来logic gate的pcell 版图。之前pcell和skill知识储备比较少,如果楼主想继续出skill教程,可以考虑一下这个哈,谢谢大佬~
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发表于 2022-9-22 17:25:16 | 显示全部楼层
顶一下
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