simulink仿真PLL

hck · 发表于 2021-6-12 11:49:16

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最近在simulink中仿真PLL时遇到一个问题，当输入基准信号Fref的占空比小于50%时PLL能正确锁定，但当输入基准信号的占空比大于50%时系统会振荡，VCO的输出信号会周期性地出现振幅衰减的情况导致环路工作不正常，Vcont、VCO的输出波形如下所示，有没有大佬知道是什么原因啊？
QQ浏览器截图20210611215342.png

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