基准电压源/PSRR电源抑制比

IFANR_1 · 发表于 2021-5-27 10:47:24

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请教一下站里大佬，小弟正在做LDO里面的基准电压源，由于LDO的基准电压源的电源抑制比不高，所以准备调整基准电压源的电源抑制比，但是基准电压源的电源抑制比确实正的，不应该是负的值吗？哪里出现问题了？谢谢各位

acging · 发表于 2021-5-27 10:59:52

bandgap严格是应该仿PSR，所以你是怎么仿真的？

IFANR_1 · 发表于 2021-5-27 11:05:10

请问二楼的大佬，还有一个，我刚发现我发的第一个图那里，NM1的vds好像没有大于vdss，是不是那个管子没有饱和的原因造成了我电源抑制比是正的而不是负的？

IFANR_1 · 发表于 2021-5-27 13:32:41

自顶希望大佬踊跃发言啊蟹蟹

gtfei · 发表于 2021-5-27 13:39:11

你的DC点有点问题，环路可能失锁没有正常建立检查一下PMOS电流镜、NMOS电流镜的尺寸，以及两个pnp三极管的个数比

IFANR_1 · 发表于 2021-5-27 13:43:24

谢谢五楼的大佬（老哥）感谢！我把第一个图片中NM1的尺寸改了，目前所有管子都在饱和区了，电源抑制比在-9dB了。请问接下来按照你说的去修改来提高这个值吗？

xuwenwei · 发表于 2021-5-27 13:54:43

看你仿真的是PSR还是PSRR，两种不一样的，另负值到db那还是正的只是小于1而已
PSR的大小和你的结构有关系的

xuwenwei · 发表于 2021-5-27 15:45:25

xuwenwei 发表于 2021-5-27 13:54
看你仿真的是PSR还是PSRR，两种不一样的，另负值到db那还是正的只是小于1而已
PSR的大小和你的结构有关系的 ...

你这个就是psr

Smart° · 发表于 2021-5-28 14:38:08

楼主，想要提高自偏置电流镜带隙基准的PSR，一种方法就是用共源共栅管，可以试试各加一组共栅管进去给你的P、NMOS。

IFANR_1 · 发表于 2021-5-29 10:04:30

谢谢九楼的老哥我试试~ 感谢

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