VCS后仿中出现$setuphold错误

sunshuo571116 · 发表于 2021-3-7 14:15:54

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各位大佬，本人遇到一个比较棘手的问题不知道咋解决？各位大佬能否给看一下，为啥我VCS后仿会出现这种$setuphold违例？还有我通过VCS波形查看有问题的信号，发现在一个周期内信号跳变了两次？这是咋回事？我明明只在始终上升沿的时候改变信号，为啥会出现这种情况，我的icc、pt明明都过了，VCS咋还会出错？

randolpha · 发表于 2021-3-7 14:36:05

是不是多时钟的关系,你看下...

sunshuo571116 · 发表于 2021-3-7 16:31:14

本帖最后由 sunshuo571116 于 2021-3-7 16:36 编辑

不好意思我知道错哪了，是我的一个小失误，之前在代码里我把反标指令$sdf_annotate给注释掉了

，导致后面用的时候延迟信息没有反标上去

sunshuo571116 · 发表于 2022-3-4 15:53:09

还有就是忘了在设计里加异步复位同步释放了

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