XHDL如何转换多个VHDL到Verilog

mxyuguoguo · 发表于 2019-12-12 16:51:11

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设计比较大，包含很多VHDL，有没有可能一起用XHDL转换呢，单个文件转换有的会失败，明明没有语法错误但是会提示error

A1985 · 发表于 2019-12-12 19:09:41

转的效果差，还不如不转。。。

alhoceima111 · 发表于 2019-12-13 12:38:24

othanks

lixinghe · 发表于 2020-9-3 20:24:53

good XHDL如何转换多个VHDL到Verilog

lixinghe · 发表于 2020-9-3 20:26:26

good very good

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