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[求助] systemverilog中import可综合吗?

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发表于 2019-7-25 16:31:16 | 显示全部楼层 |阅读模式

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代码里这么写的:
module aaa
  import  def_types::*;
(
   ...
);
我拿dc综合里了一下,报Syntax error at or near token 'import'. (VER-294)
是不是import语句不可综合?
 楼主| 发表于 2019-7-25 17:41:44 | 显示全部楼层
知道了,读文件时读的verilog,所以报这个错误
发表于 2019-12-8 18:49:04 | 显示全部楼层
后缀改成sv
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