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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 集成电路静态时序分析与建模

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楼主: 小明d

[资料] 集成电路静态时序分析与建模

发表于 2019-7-2 16:25:09 | 显示全部楼层

多谢！扫描版

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发表于 2019-7-4 09:57:56 | 显示全部楼层

have a look at this valuable book

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发表于 2019-7-9 09:59:29 | 显示全部楼层

谢谢楼主分享

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发表于 2019-7-22 20:05:32 | 显示全部楼层

太棒了，非常感谢楼组的慷慨

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发表于 2019-7-24 15:31:58 | 显示全部楼层

好好好好好好好好好

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发表于 2019-7-26 18:17:57 | 显示全部楼层

好书正在找呢

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发表于 2019-7-26 19:54:28 | 显示全部楼层

多谢分析

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发表于 2019-7-26 23:07:35 | 显示全部楼层

谢谢楼主分享

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发表于 2019-7-28 22:58:51 | 显示全部楼层

多谢分享

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发表于 2019-7-31 15:47:34 | 显示全部楼层

多谢分享

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