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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 集成电路静态时序分析与建模

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楼主: 小明d

[资料] 集成电路静态时序分析与建模

发表于 2020-9-7 16:41:47 | 显示全部楼层

Thanks

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发表于 2020-9-11 16:45:42 | 显示全部楼层

下载了很多次的资料

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发表于 2020-9-22 09:28:08 | 显示全部楼层

多谢楼主

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发表于 2020-9-22 14:57:02 | 显示全部楼层

Thanks for sharing

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发表于 2020-9-22 21:34:10 | 显示全部楼层

小明d 发表于 2019-5-18 10:37
PDF没传上去，在这重新上传一下

Goodbook， tks

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发表于 2020-9-27 10:48:40 | 显示全部楼层

感谢分享！

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发表于 2020-10-4 10:20:58 | 显示全部楼层

谢谢分享，资料很好

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西红柿是蓝色的

发表于 2020-10-4 17:12:37 | 显示全部楼层

谢谢楼主分享！

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发表于 2020-10-5 10:23:30 | 显示全部楼层

感谢

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发表于 2020-10-11 10:57:00 | 显示全部楼层

good boy,thks.

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