想请问一下大家DAC中的建立时间和采样率之间有什么确定的公式吗

bblion · 发表于 2019-1-6 15:14:39

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新手想请问一下，看cmos模拟集成电路设计那本书讲数模转换器那章里提到DAC的建立时间和运放的GB有关，那settling time是只由位数N和运放的GB确定吗？那为什么采样率（update rate）是设计指标而不是建立时间呢？

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[求助] 想请问一下大家DAC中的建立时间和采样率之间有什么确定的公式吗