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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 使用 Makefile+VCS+Verdi 做个简单的 Test Bench
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楼主: yoof2000

[原创] 使用 Makefile+VCS+Verdi 做个简单的 Test Bench

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发表于 2018-11-24 11:04:23 | 显示全部楼层
学习学习，看看
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发表于 2018-11-24 11:50:46 | 显示全部楼层
看看kankan 谢谢
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发表于 2018-11-24 13:05:50 | 显示全部楼层
非常宝贵的经验，感谢
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发表于 2018-11-24 13:54:26 | 显示全部楼层
感谢感谢
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发表于 2018-11-24 13:57:22 | 显示全部楼层
非常实用
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发表于 2018-11-24 13:58:28 | 显示全部楼层
下载试一下
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发表于 2018-11-24 16:37:11 | 显示全部楼层
脚本不知道怎么改
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metotj
发表于 2018-11-24 20:15:44 | 显示全部楼层
帆帆帆帆
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发表于 2018-11-24 20:34:12 | 显示全部楼层
Thank you!
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发表于 2018-11-25 11:33:24 | 显示全部楼层
回复 1# yoof2000


   thanks!
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