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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › 嵌入式论坛 › DSP 论坛 › DSP资料区 › dsp时钟电路的设计经验
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楼主: qzw19810822

[原创] dsp时钟电路的设计经验

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发表于 2011-2-17 15:11:58 | 显示全部楼层
我以为是内部PLL的配置方案呢
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zzl8
发表于 2011-2-17 16:55:27 | 显示全部楼层
thanks a lot
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发表于 2011-2-18 15:36:11 | 显示全部楼层
谢谢楼主分享
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arklau
发表于 2011-2-21 13:45:49 | 显示全部楼层
感谢楼主提供资料谢谢
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wsyslf
发表于 2011-3-21 22:06:06 | 显示全部楼层
顶下，支持楼主！
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arklau
发表于 2011-3-21 22:22:10 | 显示全部楼层
不晓得有没有用，不过还是谢了
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发表于 2015-1-24 14:34:28 | 显示全部楼层
回复 1# qzw19810822


    呵呵，经验之谈
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发表于 2016-12-30 15:22:41 | 显示全部楼层
不容易啊！！！必须跟下！！！
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