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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › SOC设计论坛 › SOC讨论区 › [DC] 奇葩问题
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[求助] [DC] 奇葩问题

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夏尔
发表于 2021-10-9 16:35:38 | 显示全部楼层
DC约束语句后面的就是会覆盖前面的
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chenjing0530
发表于 2021-10-14 10:32:50 | 显示全部楼层
解决这个问题的话，你定义时钟的时候-add 就不会覆盖了，也不需要debug

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