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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计讨论(IC前端|FPGA|ASIC) › low power RTL 设计优化
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楼主: yaya126

[原创] low power RTL 设计优化

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、窝里康
发表于 2019-4-17 13:04:16 | 显示全部楼层
好帖，mark
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发表于 2019-4-26 15:36:28 | 显示全部楼层
学习了。。
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reptilian77
发表于 2019-4-26 15:39:56 来自手机 | 显示全部楼层
interesting
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reptilian77
发表于 2019-4-26 15:40:48 来自手机 | 显示全部楼层
more interesting informations
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frankzf
发表于 2019-4-30 18:42:58 | 显示全部楼层
感谢感谢
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发表于 2019-5-3 23:10:58 来自手机 | 显示全部楼层
楼主为啥不更新了，想学习
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bbchgd
发表于 2019-5-4 23:22:06 | 显示全部楼层
感谢楼主的付出
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gyong22
发表于 2019-5-6 17:53:20 | 显示全部楼层
good info. thanks
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hjfu001
发表于 2019-5-7 18:17:10 | 显示全部楼层
总结得不错!!!
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yaya126
 楼主| 发表于 2019-5-8 01:10:58 | 显示全部楼层


   
危险的新哥哥 发表于 2019-5-3 23:10
楼主为啥不更新了，想学习


还在学习，不然没东西写。。。
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