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[原创] verilog中符号数的问题

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发表于 2015-10-28 19:43:59 | 显示全部楼层 |阅读模式

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比如我input定义了有符号数,然后我tb文件要输入负号,要输入的时候是需要输入数的补码来表示我输入的是负数?比如有符号数相乘,正数乘负数,我也需要输入补码才能相乘?
发表于 2015-10-28 20:45:15 | 显示全部楼层
是的,负数要输入其补码
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发表于 2015-10-29 08:11:51 | 显示全部楼层
就直接-多少就可以,10进制
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