主修ARM系列，现在自学FPGA，遇到一些问题

珠穆朗玛峰大叔 · 发表于 2015-9-2 15:38:31

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`timescale 10 ns/1 ns
module example;
reg set;
parameter p=1.6;
initial
begin
$ monitor($ time, ,"set=",set);
# p set=0;
# p set=1;
end
endmodule
这是使用modelsim进行仿真吗

02101034 · 发表于 2015-10-10 16:53:01

是的~~

madgnot · 发表于 2016-3-2 19:59:08

谢谢分析

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