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楼主: fengll

IC设计流程和EDA工具

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发表于 2018-10-2 11:19:20 | 显示全部楼层
谢谢!
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发表于 2018-10-24 13:01:29 | 显示全部楼层
不错不错!
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发表于 2018-11-21 15:37:53 | 显示全部楼层
谢谢啊 不错
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发表于 2018-12-18 04:59:32 | 显示全部楼层
Verolog:  CADENCE     Verolig-XL
               SYNOPSYS    VCS
               MENTOR      Modle-sim
     VHDL :    CADENCE     NC-vhdl
               SYNOPSYS    VSS
               MENTOR      Modle-sim
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发表于 2019-11-20 18:13:49 | 显示全部楼层
学习了,谢谢
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发表于 2020-3-5 17:16:37 | 显示全部楼层
学习
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发表于 2023-3-11 17:02:16 | 显示全部楼层
好好好
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发表于 2023-8-23 22:33:36 | 显示全部楼层
感谢分享
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