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Nicholas

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发表于 2003-9-25 20:57:09 | 显示全部楼层 |阅读模式

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三年的FPGA/ASIC设计经历,Tape out 1 chip。主要在通信领域。
在系统分析、模块划分、系统调试等方面有一些积累。
常用Verilog,工具有NCsim、Leonardo、Modelsim、DC等。
请多指教。
发表于 2003-10-9 10:29:47 | 显示全部楼层

Nicholas

小弟干的活跟你的很类似,时间短了点,1年,希望大哥以后不吝赐教。
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