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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 静态时序分析与逻辑设计华为

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楼主: yingxionga

静态时序分析与逻辑设计华为

发表于 2008-12-28 17:45:57 | 显示全部楼层

这那是什么华为的书，里面的字都不清楚

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发表于 2008-12-29 10:54:06 | 显示全部楼层

thanks！

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发表于 2008-12-29 16:30:12 | 显示全部楼层

华为的东西应该还不错，谢了

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发表于 2009-1-3 19:50:13 | 显示全部楼层

感谢！！！

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发表于 2009-1-17 21:16:18 | 显示全部楼层

see see

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发表于 2009-2-27 16:29:03 | 显示全部楼层

!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!1

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发表于 2010-1-13 10:40:55 | 显示全部楼层

感谢楼主的无私共享！！

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发表于 2010-1-13 20:45:08 | 显示全部楼层

一听就是好东西！！！

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发表于 2010-1-13 21:40:56 | 显示全部楼层

好东西，收了

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发表于 2010-1-13 23:50:23 | 显示全部楼层

好好学习了

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