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楼主: 雨丝

[求助] 高速SAR的片内reference buffer都是怎么做的?

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发表于 2015-7-7 16:02:15 | 显示全部楼层
我尝试过做8位100M,但是发现功耗太大了。试了很多结构都不行。100ps建立的要求太苛刻了
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 楼主| 发表于 2015-7-7 17:13:46 | 显示全部楼层
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 楼主| 发表于 2015-7-7 17:16:01 | 显示全部楼层


   
paper 里 ref 大部分都是连到vdd 和gnd.
vdslafe 发表于 2014-4-4 01:26




    SOC很难提供这么干净的vdd 和gnd,至少波动得小于0.5mV吧。
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发表于 2015-7-31 20:54:28 | 显示全部楼层
回复 4# vdslafe


   There might be a huge design complexity involved on the digital filter of the sigma delta ADC. The over sampling ratio is obviously reduced as you can not have large clock frequencies.
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发表于 2015-8-1 11:58:42 | 显示全部楼层
回复 84# bikku007


   如果高OSR, 1MHz bandwidth  有啥复杂
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发表于 2015-10-27 20:11:03 | 显示全部楼层
sumig,我们应该是一个实验室的
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发表于 2015-10-28 09:35:35 | 显示全部楼层
不错,非常感谢前辈们的指导
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发表于 2015-11-12 20:13:39 | 显示全部楼层
多谢多谢  受教了
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 楼主| 发表于 2015-11-20 11:36:56 | 显示全部楼层


   
回复  bikku007

   如果高OSR, 1MHz bandwidth  有啥复杂
vdslafe 发表于 2015-8-1 11:58



用连续时间sigma delta了,不过面积功耗跟做出来的SAR都差不多   (两路面积0.1  3mW,含bandgap reference buffer)  连续时间sd还有潜力可以挖吗?
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发表于 2015-11-20 18:06:48 | 显示全部楼层
回复 89# 雨丝


   不知道你期望的snr 是多少。如果FOM 大于50fj/conv, 那还是有潜力可以挖的:)
    sar 算上了前端驱动的功耗没?
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