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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › Reuse Methodology Manual补遗

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楼主: 爱玩

Reuse Methodology Manual补遗

发表于 2008-10-15 13:07:12 | 显示全部楼层

so good!!!!

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发表于 2008-11-3 17:14:56 | 显示全部楼层

多谢分享阿

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发表于 2008-11-3 18:47:07 | 显示全部楼层

感谢你的东西！
很好啊！

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发表于 2008-11-12 13:44:52 | 显示全部楼层

xiexie!!!!1

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发表于 2008-11-13 00:22:10 | 显示全部楼层

Good! Thanks a lot!

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发表于 2009-1-12 10:17:43 | 显示全部楼层

东西不错，从FPGA角度考虑的

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发表于 2009-1-12 14:25:06 | 显示全部楼层

谢谢楼主！

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发表于 2009-1-16 12:34:12 | 显示全部楼层

thanks & great

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发表于 2009-5-9 09:02:44 | 显示全部楼层

3QQQQQQQQQQQQQQQQQQQQQQQQQQQQQQQQQQQQQ!

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发表于 2009-5-9 09:08:38 | 显示全部楼层

3QQQQQQQQQQQQQQQQQQQQQQQQQQ

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