后端基本概念讨论专用贴

damonzhao · 发表于 2013-12-25 11:19:55

回复 290# wjchuan

io采用什么方式摆，这个应该看芯片的要求吧。一般都是放四周，毕竟IO区域和core区域还是有距离要求的，如果特殊ip有要求，那就按要求来。适合芯片设计要求的，最经济的方式，就是产品想要的。

Smile_HP · 发表于 2013-12-29 18:37:22

回复 279# damonzhao

谢谢你的解答，

白兰地 · 发表于 2013-12-31 16:22:04

想请问一下，DC综合完后，要如何知道我们给的约束是正确的，约束到了所有的寄存器。

白兰地 · 发表于 2014-1-6 09:07:17

ICC中对于多时钟有什么特殊要求或者处理呢，时钟树完后，查看不到时钟树。

hewf · 发表于 2014-1-15 14:58:38

能做成合集吗？

zengbinjian · 发表于 2014-1-23 23:24:18

犀利，新手刚入门，以后多指教

andfenghui · 发表于 2014-2-11 13:19:26

回复 5# 陈涛

q强烈顶起，俺是这方面的小白，就是想学一些最最基本的。然后不再做菜鸟

andfenghui · 发表于 2014-2-11 13:36:29

derive_pg_connection -power_net VDDNB -power_pin VDDF
Error: Pin name VDDF specified by power_pin or ground_pin option is invalid. (MWUI-715)
Error: derive_pg_connection failed
XXX.log出现这样子错误一般怎么解决？

andfenghui · 发表于 2014-2-11 13:41:10

回复 75# jiangweihui

这个问题我貌似看过
http://bbs.eetop.cn/thread-177557-1-1.html 看这里

andfenghui · 发表于 2014-2-11 16:34:08

Error: Generated clock 'GNB_LbistShiftClk with source pin SC2GpuClk' 'rise_edge' is not satisfiable; zero source latency will be used (UITE-461) 请问这个问题怎么处理啊？严重吗？要不要做啥啊

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