设为首页 收藏本站
在线咨询 切换到宽版
eetop公众号 创芯大讲堂 创芯人才网

 找回密码
 注册

手机号码，快捷登录

手机号码，快捷登录

搜帖子
EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › IC验证 › IC验证讨论 › ctags+systemverilog
返回列表 发新帖
查看: 3190|回复: 0

[原创] ctags+systemverilog

[复制链接]
发表于 2012-6-7 16:30:51 | 显示全部楼层 |阅读模式

马上注册，结交更多好友，享用更多功能，让你轻松玩转社区。

您需要 登录 才可以下载或查看，没有账号？注册

×
我看vmm库的时候，代码里面有很多宏定义 譬如`VMM_LOG_BASE，
我用ctags生成tags文件后打开tags文件，看到了这个宏定义，但是在.sv文件中光标移到`VMM_LOG_BASE，然后ctrl+]缺没有跳到这个宏定义处，
大家知道这是怎么回事吗
但是, 文件

相关帖子
回复

使用道具 举报

返回列表 发新帖
高级模式
B Color Image Link Quote Code Smilies
您需要登录后才可以回帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /1 下一条

X

手机版| 小黑屋| 关于我们| 联系我们| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2025-7-12 01:17 , Processed in 0.087664 second(s), 10 queries , Gzip On, MemCached On.

eetop公众号 创芯大讲堂 创芯人才网
快速回复 返回顶部 返回列表