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楼主: forlsy

[讨论] always实现组合逻辑.常用吗?

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发表于 2012-9-11 14:40:50 | 显示全部楼层
我也觉得用always可读性更强,相对来说更好写
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发表于 2012-9-14 14:15:52 | 显示全部楼层
楼上说的都有道理,个人感觉主要因为always可读性好,assign写很长没法读
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发表于 2012-9-15 19:14:47 | 显示全部楼层
這應該是每個人coding style的不同,,,
always(*)是  Verilog 2001的語法...
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发表于 2013-1-11 09:58:33 | 显示全部楼层
10楼正解
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发表于 2017-5-2 15:08:12 | 显示全部楼层
有道理
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发表于 2017-5-3 12:36:36 | 显示全部楼层
always组合逻辑还是挺多的,我们公司一般使用always写组合逻辑
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发表于 2017-5-10 11:05:07 | 显示全部楼层
回复 1# forlsy


   always 写组合电路,代码风格便于阅读,公司存档
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发表于 2024-8-5 13:44:02 | 显示全部楼层
学习了
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