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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog/RF IC 设计 › Analog/RF IC 设计讨论 › Fractional-N PLL 测试中遇到的问题，欢迎讨论 ...
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楼主: bn0925

[求助] Fractional-N PLL 测试中遇到的问题，欢迎讨论

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发表于 2012-9-22 22:37:16 | 显示全部楼层
兄弟，能大概讲讲版图是哪里出问题吗？
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发表于 2012-9-23 08:50:29 | 显示全部楼层
xuexi，nice
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发表于 2012-9-23 09:16:59 | 显示全部楼层
楼主，同上~~·渴望知道版图上的问题出在哪哈~~~
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发表于 2013-5-13 22:45:00 | 显示全部楼层
SDM。。
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caxias
发表于 2013-10-31 16:38:27 | 显示全部楼层
READY STUFFFFFFFFFFF
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发表于 2024-4-29 22:07:12 | 显示全部楼层
请问楼主，您做的PLL输出buffer是什么结构呢？CML输出吗？
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